3年以上候選人，設(shè)計(jì)崗要求有radio經(jīng)驗(yàn)；驗(yàn)證崗要求有systemverilog經(jīng)驗(yàn)，UVM用過(guò)了解即可。
2年以內(nèi)候選人(應(yīng)屆生也可以)，懂FPGA即可，學(xué)歷要求碩士或者211/985以上。
1. FPGA design Consultant Radio design Job Title:

FPGA Design engineer

Job Objective:

To be responsible for Radio FPGA design, integration and maintenance.

Responsibilities:

Be responsible for Radio FPGA design, including DDC, DUC, RRC filter, CIC filter, sample rating mapping, and all external related interfaces.

Be responsible for related documentation of requirement, architecture, design specification and verification

Be responsible for FPGA design, verification and debugging.

Qualifications & Requirements:

At least one year working experience in digital IF design, graduated from Telecommunication, computing or related majors. Good telecommunication theory background.

Be familiar with digital IF design, be familiar high speed ADC, DAC and other external analog circuits, be familiar with radio structure and design methodology.

Be good at Verilog and VHDL coding and verification.

Be good at digital filter, frequency conversion, extraction, interpolation design, simulation and FPGA implementation

Be familiar with FPGA interface function and logic, high speed SERDES, parallel bus interfaces, serial bus interfaces.

Be good at English, reading, writing, speaking and listening.

Good sense of co-working with team members under CVS/ClearCase like source control environments is a plus.

Linux environment working capable is a plus; knowledge of script/Shell is a plus.

文思海輝是一家來(lái)自中國(guó)的全球性IT服務(wù)公司，擁有超強(qiáng)的數(shù)字化咨詢與行業(yè)解決方案實(shí)施能力，致力成為全球企業(yè)“最具價(jià)值的業(yè)務(wù)合作伙伴”。文思海輝堅(jiān)持為全球客戶提供領(lǐng)先的數(shù)字化咨詢、體驗(yàn)交互、技術(shù)實(shí)施與運(yùn)營(yíng)服務(wù)，并憑借在高科技、金融、制造等行業(yè)的深厚積累和豐富經(jīng)驗(yàn)，與128家《財(cái)富》500強(qiáng)企業(yè)建立了長(zhǎng)期合作關(guān)系。
而這些，皆源于文思海輝26,300余名專業(yè)人才的協(xié)作與努力！你是否愿意加入我們，成為26300余名專業(yè)人才中、令人驕傲與艷羨的一員？
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在文思海輝，更有令人鼓舞的工作環(huán)境，追夢(mèng)路上，彼此稱贊。
這是我們的員工價(jià)值主張，更是我們對(duì)每一位應(yīng)聘者的期待與承諾。
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